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基本加法電路圖及原理

是加法電路的原理圖。圖5.4-1A為反相輸入加法電路。UI1，UI2，UI3為加到運放放大器反相輸入端的待加的輸入信號。作為加法電路，輸入端數目可根據待相加信號數目進行任意擴展。圖中∑點為虛地點，IF=I1+I2+I3，輸出電壓

為了保證電路具有平衡對稱結構（用以消除輸入偏流及其溫漂的影響），電阻R應滿足RP||R1=R1||R2||R3||R

由運算放大器構成的加法電路，有反相與同相之分，二者相比較，反相輸入加法電路，其輸入之間不存在交擾問題，也沒有共模電壓干擾存在，調節方便，因而作為求和（加法）電路通常把運放反相使用。