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基本高速積分電路圖及原理

基本高速積分電路圖及原理

當(dāng)密勒積分電路的時(shí)間常數(shù)T1較小時(shí)即在高速運(yùn)行的情況下，出現(xiàn)了實(shí)際輸出波波形滯后于理想情況一段時(shí)間，解決這一問題的辦法是選用通頻帶較寬的運(yùn)放或者采用圖5.4-11所示的高速積分電路。由于積分是反相使用運(yùn)放，所以該電路得以采用前饋補(bǔ)償技術(shù)，提高了運(yùn)放的增益帶寬積，使滯后的情況有較顯著的改善，輸出UO的響應(yīng)比較迅速，這就是該電路稱作高速積分電路的緣故。C4是前饋補(bǔ)償電容。由R2將C2和C2分離開來。